ISERDESE3 のポート

UltraScale アーキテクチャ SelectIO リソース ユーザー ガイド (UG571)

Document ID
UG571
Release Date
2023-08-31
Revision
1.15 日本語

表: ISERDESE3 のポート に ISERDESE3 のポートを示します。

表 2-6: ISERDESE3 のポート

ポート

I/O

タイプ

説明

CLK

入力

クロック

高速クロック入力。シリアル入力データ ストリームのクロック信号。

CLK_B

入力

クロック

IS_CLK_INVERTED = 0 かつ IS_CLK_B_INVERTED = 0 の場合、CLK の反転信号。

CLKDIV

入力

クロック

低速の分周クロック入力。

D

入力

データ

CLK/CLK_B に同期したシリアル入力データ。

Q[7:0]

出力

データ

レジスタ付き出力。FIFO_ENABLE を TRUE にした場合、FIFO_RD_CLK に同期。

RST

入力

リセット

非同期リセット信号。

FIFO_RD_CLK

入力

クロック

FIFO 読み出しクロック。

FIFO_RD_EN

入力

イネーブル

アサートされると FIFO の読み出しが可能になる。

FIFO_EMPTY

出力

アサートされると、FIFO が空になることを示す。

INTERNAL_DIVCLK

出力

クロック

予約