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はじめに

はじめに

製品概要
 Vitis Model Composer デザインの作成およびシミュレーション
 Vitis Model Composer Hub ブロックの使用
 AMD Versal アダプティブ SoC デバイスへの FIR フィルターのインプリメンテーション
 MathWorks - Simulink と Vitis Model Composer を使用した AMD Versal アダプティブ SoC の AI エンジンの設計
 MathWorks - FPGA デザインおよび協調デザイン
チュートリアル デザイン
 GitHub - Vitis Model Composer のサンプル デザインとチュートリアル
 GitHub - Vitis チュートリアル
ユーザー ガイド (英語)
 Vitis Model Composer ユーザー ガイド (UG1483)
 AI エンジン ツールおよびフロー ユーザー ガイド (UG1076)
 AI エンジン カーネルおよびグラフ プログラミング ガイド (UG1079)
 Vitis ユーザー ガイド: データセンター アクセラレーション (UG1700)
 ユーザー ガイド: IP を使用した設計 (UG896)
 Vivado Design Suite ユーザー ガイド: カスタム IP の作成およびパッケージ (UG1118)
アプリケーション ノート (英語)
 Model Composer を使用した PID コントローラー デザイン - Versal アダプティブ SoC 向け (XAPP1376)
 リファレンス デザイン ファイル
 Model Composer を使用した PID コントローラー デザイン アプリケーション ノート (XAPP1341)
 リファレンス デザイン ファイル

サポート リソース

サポート リソース

リリース ノート (英語)
 Vitis Model Composer 製品ページ - 新機能
よくある質問 (FAQ) (英語)
 アンサー 59432 - ライセンス チェックアウトのタイミング
フォーラムおよびトレーニング
 フォーラム - DSP IP およびツール
 Vitis Model Composer: MATLAB および Simulink をベースにした製品